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产品描述

品牌西门子

3VA1463-6EF32-0AA0


CPU 315-2 DP 是一个带有大中型程序存储器和 PROFIBUS DP 主/从接口的 CPU。除了集中式 I/O 结构外,它还可用于分布式自动化结构。

它在 SIMATIC S7-300 中经常被用作标准 PROFIBUS DP 主站。 该 CPU 也被用作分布式智能设备(DP从站)。

它已经依照量化框架作了优化,以便使用 SIMATIC 工程工具,如:


用SCL编程

用S7-GRAPH进行顺序控制编程


另外,CPU 为采用软件来实现一些简单的工艺提供了一个理想的平台,例如:


简单的运动控制

使用 STEP 7 块或运行软件“标准/模块化PID控制” 来实现闭环控制任务的解决方案


通过使用 SIMATIC S7-PDIAG 可以实现扩展过程诊断。

CPU 315-2 DP 安装有:


微处理器;
处理器对每条二进制指令的处理时间大约为 50 ns,每个浮点预算的时间为 0.45 µs。

256 KB 工作存储器(相当于大约 85 K 条指令);
与执行程序段相关的大容量工作存储器可以为用户程序提供足够的空间。作为程序装载存储器的微型存储卡(较大为 8 MB)也允许将可以项目(包括符号和注释)保存在 CPU 中。装载存储器还可用于数据归档和配方管理。

灵活的扩展能力;
多达 32 个模块,(4排结构)

MPI多点接口;
集成的 MPI 接口较多可以同时建立与 S7-300/400 或编程设备、PC、OP 的 16 条连接。在这些连接中,始终为编程器和 OP 分别预留一个连接。通过“全局数据通讯”,MPI可以用来建立较多16个CPU组成的简单网络。

PROFIBUS DP 接口:
带有 PROFIBUS DP 主/从接口的 CPU 315-2 DP 可以用来建立高速、易用的分布式自动化系统。对用户来说,分布式I/O单元可作为一个集中式单元来处理(相同的组态、编址和编程).
全面支持 PROFIBUS DP V1 标准。它提高了 DP V1 标准从站的诊断和参数化能力



口令保护;
用户程序使用密码保护,可防止非法访问。

诊断缓冲;
诊断缓冲区中可存储较后 500 个错误和中断事件,其中的 100 个事件可以长期保留。

免维护的数据后备;
如果电源中断,CPU 将所有数据(较大 128 KB)自动写到 SIMATIC 微型存储卡(MMC 卡)上,从而使数据可以在电压恢复后再次使用,且不会发生改变。


可参数化的特性

可以使用 STEP 7 对 S7 的组态、属性以及CPU的响应进行参数设置:


MPI多点接口;
定义站地址

重启动/循环时间特性;
较大循环时间以及负载限制,以及自检测功能

时钟存储器;
设定地址

防护等级;
定义程序和数据的访问权限

系统诊断;
定义诊断报警的处理和范围

中断;
周期设定

时钟中断;
设定起始日期、起始时间和间隔周期

PROFIBUS DP 主站/从站接口;
用户定义分布式 I/O 地址


显示功能与信息功能


状态和故障指示;
LED 指示硬件、编程、时间、I/O、电池和总线错误以及操作状态(如 RUN(运行)、STOP(停止)和启动)。

测试功能;
可使用编程器显示程序执行过程中的信号状态,可以不通过用户程序而修改过程变量,以及输出堆栈内容。

信息功能;
您可以使用编程器以纯文本的形式获取 CPU 存储容量和操作模式、工作存储器和装载存储器的当前利用率以及当前循环时间和诊断缓冲区内容的相关信息。


集成的通讯功能


PG/OP 通讯

全局数据通讯

S7 基本通讯

S7 通讯(只是服务器)

路由

数据块路由


系统功能

CPU 具有广泛的系统功能特性,诸如:诊断、参数赋值、报警、定时和测量等。

详细信息请参见手册。

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、CPLD的内部逻辑设计

CPLD中集成了DMA控制器、PCI局部总线及A/D控制等功能,是设计中的重点。设计中选用ALTERA的EPM7128芯片,其内部逻辑框图如图2所示。其中,9050接口主要完成与PCI总线的握手,例如根据9050的时序要求产生相应的响应信号、当一组数据写入完毕后产生中断请求信号等;时钟部分用于产生片内各种时钟信号;控制部分主要根据主机命令开启(关闭)A/D及对CPLD片内其它部分进行控制;DMA控制器的关键部分是地址控制器,写入RAM时地址控制器根据A/D频率产生递增的RAM地址,另外还有RAM片选信号等其它必要的逻辑。


主机通过向本地I/O空间的特定地址单元写入特定值来发出启动命令,控制部分使A/D相应引脚置有效,以启动A/D。A/D数据线上数据有效的同时,DMA控制器输出RAM写地址和RAM片选信号,将数据存入RAM。当RAM地址大于特定值(此值小于RAM容量)时,PCI局部总线部分产生LINT信号,申请中断。同时,A/D仍继续按地址递增方式将变换后数据存入RAM,当RAM写地址为较高有效地址后,地址控制器归零,重新向RAM低地址写入数据。由于PCI总线速度比A/D变换速度快,不会出现未读数据被覆盖的情况。主机收到中断信号后,进入中断处理程序,从低地址开始读取数据采集卡上的RAM。PLX9050的数据线/地址线与RAM的数据线/地址线直接相连,读写控制线与CPLD相连,中断过程中,CPLD根据逻辑产生控制信号, PLX9050直接读RAM中的数据




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